论文中首先讨论了DDR SDRAM的特性,DDR控制器的基本结构和时序,以及PCI总线的基本结构和时序,并介绍了FPGA的基本原理和开发过程。
来源:互联网摘选质量检测模块中完成:对图像数据样本发生的控制;对数字样本缓存的读写控制;完成对所摄取的图像识别,并输出代表质量类型的信息码。
来源:互联网摘选本文提出了SDRAM预取FIFO的设计,充分利用SDRAM的流水特性,提高无Cache嵌入式处理器性能。
来源:互联网摘选介绍视音频延时器用大容量FIFO的设计,大容量FIFO的设计采用了SDRAM代替双口RAM,并采用FPGA设计双口SDRAM控制器。
来源:互联网摘选通过硬件平台上的高速DDR SDRAM模块,可以提高FPGA数据端口的吞吐量,满足高速D/A转换器对其数字接口传输速率的要求。
来源:互联网摘选本文介绍了在雷达光栅显示系统中,应用SDRAM作为视频存储器时,采用FPGA实现控制电路的过。
来源:互联网摘选Secondly, the main Circuit design of SDRAM and IDE BUS interface by Allegro are analyzed in details;
然后,详细介绍了利用Allegro实现嵌入式系统中SDRAM和IDE总线接口的电路设计;
来源:互联网摘选同步动态随机存储器SDRAM因其容量大、读写速度快、支持猝发式读写及相对低廉的价格而得到了广泛的应用。
来源:互联网摘选DDR SDRAM(Double Data Rate SDRAM,双倍数据率同步动态随机存储器)以其高速率、大容量和良好的兼容性在这些需求存储设备的领域得到了相当广泛的应用。
来源:互联网摘选SDRAM控制器设计采用自顶向下模块化的设计方法,共分为四个模块:SDRAM控制器顶层模块、控制接口模块、命令模块和数据通路模块,SDRAM控制器顶层模块初始化并把其余三个模块有机地结合起来。
来源:互联网摘选阐述了一种采用普通DDR内存即可实现的高速大容量报文缓存方案,并在FPGA中实现了DDR内存接口管理控制器。
来源:互联网摘选Modules Design and Verification Technology Research of DDR2 SDRAM Controller
DDR2内存控制器的模块设计和验证平台技术研究
来源:互联网摘选Design and realization of high speed and deep asynchronous FIFO based on DDR2 SDRAM
基于DDR2SDRAM的高速大容量异步FIFO的设计与实现
来源:互联网摘选The design and verification based on FPGA for integrity of DDR2 SDRAM interface signals
基于FPGA的DDR2SDRAM接口信号完整性设计与验证
来源:互联网摘选DDR2 SDRAM is, at present, one of the most widely used kind of the memory.
DDR2内存是目前应用最为广泛的存储器产品之一。
来源:互联网摘选在高速、大容量存储的系统设计中,DDR2SDRAM为设计者提供了高性价比解决方案。
来源:互联网摘选
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